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如果把D触发器的输出Q反馈连接到输入D，则输出Q的脉冲波形的频率为CP脉冲频率f的（）。

题目
单选题
如果把D触发器的输出Q反馈连接到输入D，则输出Q的脉冲波形的频率为CP脉冲频率f的（）。
A

二倍频

B

不变

C

四分频

D

二分频

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第1题：

画出图题5-11所示的脉冲JK触发器输出Q端的波形，输入端J K与CLK的波形如图所示。(设Q初始状态为0)


答案：

第2题：

画出图题5-8所示的JK触发器输出Q端的波形，输入端JK与CLK的波形如图示。(设Q初始状态为0)


答案：

第3题：

试分别画出图4-30(a)电路输出端Y、Z和图4-30(b)电路输出端Q2的波形.输入信号A和CP的电压波形如图4-30(c)所示,各触发器的初始状态为0.


答案:

第4题：

由两个主从型JK触发器组成的逻辑电路如图a）所示，设Q1、Q2的初始态是00，已知输入信号A和脉冲信号CP的波形如图b）所示，当第二个CP脉冲作用后，Q1Q2将变为（　　）。

A．11
B．10
C．01
D．保持00不变

答案：C
解析：
根据触发器符号可见输出信号在CP脉冲的下降沿动作。根据JK触发器的特征方程

得到当第二个CP脉冲作用后，Q1Q2将变为01。

第5题：

JK触发器及其输入信号波形如图所示，该触发器的初值为0，则它的输出Q为：



答案：B
解析：
图示电路是电位触发的JK触发器。当cp=1时，触发器取输入信号JK。触发器的状态由JK触发器的功能表（表格略）确定。

第6题：

试画出图题5-19所示电路中触发器输出Q1、Q2端的波形，输入端CLK的波形如图所示。(设Q初始状态为0)


答案：

第7题：

画出图题5-5所示的边沿触发D触发器输出端Q端的波形，输入端D与CLK的波形如图所示。(设Q初始状态为0)


答案：

第8题：

图4-27(a),(b)分别示出了触发器和逻辑门构成的脉冲分频器电路,CP脉冲如图4-27(c)所示,各触发器的初始状态皆为0.

(1)试画出图4-27(a)的Q1、Q2和F的波形.

(2)试画出图4-27(b)的Q1、Q2和Y的波形.


答案:

第9题：

D触发器组成的电路如图a)所示。设Q1、Q2的初始态是0、0，已知CP脉冲波型，Q2的波形是图b)中哪个图形？


答案：A
解析：
提示：从时钟输入端的符号可见，该触发器为正边沿触发方式。即：当时钟信号由低电平上升为髙电平时刻，输出端的状态可能发生改变，变化的逻辑结果由触发器的逻辑表决定。

第10题：

由两个主从型JK触发器组成的逻辑电路如图a)所示，设Q1、Q2的初始态是0、0， 已知输入信号A和脉冲信号CP的波形，如图b)所示，当第二个CP脉冲作用后，Q1、Q2将变为：


A. 1、1
B. 1、0
C. 0、1
D.保持0、0不变

答案：C
解析：
提示：该触发器为负边沿触发方式，即：当时钟信号由高电平下降为低电平时刻输出端的状态可能发生改变。

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