把一个三进制计数器和一个四进制计数器串联起来可构成（）。A、七进制计数器B、12进制计数器C、14进制计数器D、24进制计数器

题目

把一个三进制计数器和一个四进制计数器串联起来可构成（）。

A、七进制计数器
B、12进制计数器
C、14进制计数器
D、24进制计数器

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相似问题和答案

第1题：

通常将二进制计数器与五进制计数器上串，可得到十进制计数器，若将十进制计数器与六进制计数器相串，可得十六进制计数器。()

参考答案：错误

第2题：

A.同步二进制加法计数器
B.同步二进制减法计数器
C.异步二进制减法计数器
D.异步二进制加法计数器

答案：C

解析：

CP没有接到所有触发器的时钟端，因此是异步时序电路，具有减法规律。

第3题：

把一个5进制计数器与一个10进制计数器串联可得到15进制计数器。()

参考答案：错误

第4题：

图示是一个集成74LS161集成计数器电路图，则该电路实现的逻辑功能是（　　）。

A．十进制加计数器
B．四进制加计数器
C．八进制加计数器
D．十六进制加计数器

答案：C

解析：

加法计数器74LS161预置数端接地，无预置数。根据输出端逻辑关系，即当Q3Q2Q1Q0＝（0111）2时，下个CP脉冲，电路重新置零。从（0000）2到（0111）2需计数8次，因此该电路实现的逻辑功能是八进制计数器。

第5题：

采用中规模加法计数器74LS161构成的计数器电路如图所示，该电路的进制为（　　）。

A．十一进制
B．十二进制
C．八进制
D．七进制

答案：B

解析：

74LS161为集成计数器，利用其异步清零功能（即CR＝0时置零）实现十二进制记数功能，主循环过程如下图所示。

由图可知，74LS161从0000状态（置零状态）开始计数，当输入第12个CP脉冲（上升沿）时，输出QDQCQBQA＝1100，

此时异步清零低电平动作，计数器返回0000状态重新开始计数。

第6题：

由四位二进制同步计算器74161构成的逻辑电路如图所示，该电路的逻辑功能
为（ )。

A.同步256进制计数器
C.同步217进制计数器
B.同步243进制计数器
D.同步196进制计数器

答案：A

解析：

解 CO=Q0· Q1 · Q2 · Q3· CE
初始状态为0000?0000，当右面的计数器C0输出为1时，也就是当所有输出为1111? 1111时，整个计数器通过置数法置成0000?0000。
答案:A

第7题：

图所示电路，集成计数器74LS160在M＝1和M＝0时，其功能分别为（　　）。

A．M＝1时为六进制计数器，M＝0时为八进制计数器
B．M＝1时为八进制计数器，M＝0时为六进制计数器
C．M＝1时为十进制计数器，M＝0时为八进制计数器
D．M＝1时为六进制计数器，M＝0时为十进制计数器

答案：A

解析：

74LS160为同步十进制计数器，当为低电平时，将D3、D2、D1、D0置入计数器。当M＝1时，初始值为0100，计数器根据CP脉冲开始计数，0100→0101→0110→0111→1000→1001，当计数到1001时Q3和Q0经与非门使得LD=0，则计数器将初始值0100置数到输出端，进行下一轮计数，因此当M＝1时为六进制计数器。当M＝0时，初始值为0010，计数器根据CP脉冲开始计数，0010→0011→0100→0101→0110→0111→1000→1001，当计数到1001时Q3和Q0经与非门使得，则计数器将初始值0010置数到输出端，继续进行下一轮计数，因此当M＝0时为八进制计数器。

第8题：

把一个五进制计数器与一个四进制计数器串联可得到()进制

A、4

B、5

C、9

D、20

参考答案D

第9题：

图示电路的逻辑功能为（　　）。